FPGA高級(jí)開發(fā)工程師（交流伺服驅(qū)動(dòng)器）
20000元以上
應(yīng)屆畢業(yè)生
碩士
應(yīng)屆畢業(yè)生
碩士
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
2025-05-01 09:20:48
1807人關(guān)注
職位描述
該職位還未進(jìn)行加V認(rèn)證，請(qǐng)仔細(xì)了解后再進(jìn)行投遞！
1. 精通伺服驅(qū)動(dòng)器的電流環(huán)邏輯控制，電流環(huán)優(yōu)化和編碼器編解碼的FPGA邏輯開發(fā)、設(shè)計(jì)和實(shí)現(xiàn)，包括方案設(shè)計(jì)、軟件編譯和調(diào)試。
2. 負(fù)責(zé)伺服驅(qū)動(dòng)器的 FPGA 邏輯架構(gòu)的設(shè)計(jì)工作，按產(chǎn)品設(shè)計(jì)要求編寫、測(cè)試 FPGA 等底層驅(qū)動(dòng)程序，并完成相關(guān)文檔編輯和整理。
3. 負(fù)責(zé)伺服驅(qū)動(dòng)器的FPGA的邏輯仿真和驗(yàn)證及時(shí)序優(yōu)化。
4.熟悉Lattice，Altera等常用FPGA邏輯開發(fā)和編譯環(huán)境Quartus II。5. 配合DSP工程師進(jìn)行三環(huán)調(diào)試和PID調(diào)試，并口通信，以及融合控制算法，優(yōu)化性能。
2. 負(fù)責(zé)伺服驅(qū)動(dòng)器的 FPGA 邏輯架構(gòu)的設(shè)計(jì)工作，按產(chǎn)品設(shè)計(jì)要求編寫、測(cè)試 FPGA 等底層驅(qū)動(dòng)程序，并完成相關(guān)文檔編輯和整理。
3. 負(fù)責(zé)伺服驅(qū)動(dòng)器的FPGA的邏輯仿真和驗(yàn)證及時(shí)序優(yōu)化。
4.熟悉Lattice，Altera等常用FPGA邏輯開發(fā)和編譯環(huán)境Quartus II。5. 配合DSP工程師進(jìn)行三環(huán)調(diào)試和PID調(diào)試，并口通信，以及融合控制算法，優(yōu)化性能。
注：聯(lián)系我時(shí)，請(qǐng)說(shuō)是在濱海人才網(wǎng)上看到的。
工作地點(diǎn)
地址：長(zhǎng)沙寧鄉(xiāng)市楚天科技工業(yè)園
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職位發(fā)布者
HR
北京福睿思特國(guó)際人力資源有限公司
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咨詢（財(cái)會(huì)·法律·人力資源）
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100-199人
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私營(yíng)·民營(yíng)企業(yè)
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北京市朝陽(yáng)區(qū)西大望路22號(hào)院1號(hào)樓商業(yè)部分4層09A
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